芯片是种矛盾的存在。它其贤人，能在指甲盖大小的面积上完成数十亿次运算；但也其脆弱：线路的硅片薄如蝉翼，怕摔、怕热、怕灰尘，致使怕空气中的水分。颗芯片从晶圆上切割下来后，若是不加保护径直使用那曲塑料管材生产线价格，大致撑不外几分钟。

这等于“封装”（packaging）存在的意旨。封装主要帮芯片惩办三个问题：是保护，给脆弱的硅片穿表层“铠甲”，让它能在果真全国中存活；二是供电与相连，芯片需要电力才能责任，也需要和外界交换数据，封装要把电源和信号通路从电路板路接到芯片里面数以亿计的晶体管上；三是散热，芯片运算时产生的热量惊东谈主，若是散不出去，芯片会降频致使毁。

但如今，每个问题的惩办齐变得越来越难。

昔日几十年，摩尔定律直引半体产业上前。晶体管不休削弱，一样面积的芯片能塞进多揣摸单位，能握续翻倍。可近几年，制程的研发老本呈指数飞腾，台积电 3 纳米的次流片用度已过数亿好意思元；物理限也在靠近，当晶体管栅宽度惟有几个原子尺寸时，量子隧穿应运行侵略，走电问题险些法根。

于是，行业把见识投向了另个向：与其把整个硬塞进块芯片，不如把多块芯片用小巧的式拼装在起，让它们协同责任，仿佛颗大的芯片。这等于封装（Advanced Packaging）的中枢念念路。

台积电的 CoWoS（晶圆芯片堆叠封装）和 HBM（带宽内存）的堆叠封装等于个典型例子。英伟达每代 AI GPU 齐在用大面积的 CoWoS 中介层，把多 HBM 颗粒拉到 GPU 身边，靠封装层面的互连密度和带宽来\"喂饱\"算力。

正因如斯，封装在昔日几年被委派厚望，被视为“接棒摩尔定律”的重要旅途，对东谈主工智能发展至关紧迫。英伟达技巧集团总监 Sandeep Razdan 在本年 iMAPS（微电子拼装与封装学会）大会上明确暗示：“今生动正驱动能的，不再是每块 GPU 有些许万亿次浮点运算智力，而是系统架构和系统合座能。”

当系统架组成为能驱能源时，封装就不再是芯片蓄意完成后的“扫尾责任”，而是能程式本人的部分。基板的遴荐、键界面的质地、散热旅途的蓄意，致使工艺智商的先后律例，齐会径直决定终能作念出什么样的家具。可问题在于，封装自身也正在撞墙。

本年 iMAPS 大会上反复出现的个重要词是“翘曲”。这个看似纯粹的机械问题，正成为封装的头号难题。翘曲的骨子，是封装里面不同材料之间的热蔓延总计不匹配。领略，封装的堆叠结构里同期用了好几种聚物，它们各自有不同的玻璃化调遣温度，当温度越过其中任何种材料的临界点时，该材料的硬度会急剧着落、热蔓延总计顿然升，翘曲也随之加重。

发愤的是，翘曲并不是个颓靡的问题。它会传到后续的每个工艺智商：基板翘了，芯片就贴不服，瞄准精度就会着落；瞄准出了偏差，键良率就掉下来；良率掉，老本就扛不住。当封装尺寸还比拟小的时候，翘曲免强不错通过工艺支持来赔偿，但当模组尺寸握续增大，AI 芯片的封装面积仍是靠近光罩限。点点抨击，就可能激发系统的良率问题。

为了布置翘曲，行业把见识投向了三个向：底层基材、互连式和空间架构。

先是底层基材的替换那曲塑料管材生产线价格，传统的有机塑料基板在温下易发生热胀冷缩，是致封装翘曲的元凶。为了布置这问题，行业将见识投向了玻璃。玻璃的势不问可知：对平整、尺寸自若，且热蔓延总计与表层的硅片其接近。有工程师指出，手脚封装载体，玻璃能将翘曲截止在远于有机材料的水平。

但玻璃也带来了新问题：它是脆材料。微裂纹、角落崩损、搬运经过中的碰撞，齐可能致不行逆的毁伤。有厂商致使门诱骗了种摆锤冲击测试来评估玻璃载体的角落韧，因为他们发现传统测试法法充分捕捉果真搬运要求下的角落毁伤。

若是玻璃载体需要回收重叠使用，眇小劣势还会随时分积贮，在某次工艺中短暂失。也有指示，隔热条设备玻璃面板越大，翘曲和残余应力越大，况且这种应力是积贮的。换句话说，玻璃惩办了类问题，却带来了另类问题。

其次是互连式的升，行业运行迈向混键（Hybrid Bonding）。若是说玻璃惩办的是“地基”问题，混键惩办的等于“通路”问题。它撤废了传统的金属凸块焊锡，径直让两块芯片名义的铜和铜在微不雅法度下熔相连。这是现在能达成互连密度的旅途，关于渴求致带宽和低延伸的 AI 芯片而言险些不行替代。

但这项技巧正濒临两端夹攻的奥秘逆境。在键间距大于 5 微米时，良率主要取决于环境够不够干净；可旦间距削弱到 2 至 3 微米以下，游戏章程就变了。的铜密度带来了巨大的机械应力，铜的热蔓延与周围介电质层的敛迹造成拉锯，致失时制从“微尘稠浊”突变为“应力扯破”。

同期，它对稠浊的度明锐依然存在——由于是纯刚界面对接，莫得任何有机材料提供柔缓冲，颗纳米灰尘就可能顶起通盘界面，报废大片晶圆。工程团队面对的，不再是不错相关火力攻克的单难题，而是稠浊与应力度耦的死结。

后是空间架构的翻转：探索后面供电（Backside Power Delivery）。跟着芯片正面布线密度的弥散，工程师们运行汲取“背向出线”的战术：把本来拥堵在芯片正面的电源收集滚动到硅片后面，将正面空间留给数据信号。

但这也让制造工艺靠近了物理操作的限。为了把电源引出，本来坚固的硅片需要被研磨到薄，频繁只剩 5 微米（不到头发丝直径的特殊之）。如斯端的减薄，对底层的临时键材料建议了严苛要求：键胶厚度的任何眇小偏差，齐会径直传为硅片研磨后的厚薄不均，这对 HBM 等堆叠存储芯片是致命的。此外，解键后若清洗不，残留物又会在后续工序中化身为新的良率手。

不错说，封装正在变成部“积贮的机械历史”。每步工艺齐在往系统里注入应力和不祥情，每步的错误齐在蚕食下步的工艺窗口。用位的话来讲：“每步齐会引入某种应力，你须确保这步产生的应力不会大到让下步法链接。”

固然现在阶段，以上问题的商议主要发生在台积电、英伟达、Amkor、ASE 这些处于技巧前沿的公司之间。但关于正在全力追逐封装的大陆企业来说，一样值得崇敬扫视。

昔日两年，在算力需求爆发与供应链自主可控的驱动下，长电科技、通富微电、盛晶微等原土厂商正加快产能爬坡。关系词，面对发收窄的试错窗口，追逐者濒临的挑战不仅是商场开拓，是严苛的技巧卓绝。据行业预测，各人封装商场将在改日五年打破千亿好意思元大关，但国内厂商在中枢的 2.5D/3D 端商场份额依然有限。

外部竞争的标杆正在被以台积电为的头部企业大幅拔。供应链新数据透露，台积电预测到 2026 年底其 CoWoS 月产能将擢升至 15 万片晶圆当量，仅英伟达的新代架构就锁定了大部分份额。封装已不仅是制造的终端要道，而是果真开启了\"代工 2.0\"时期。

这种快速进也放大了前文提到的工程系统难题。当封装尺寸靠近限、混键间距参加亚微米，国内企业试图快速跟进时，直面的不再是单互连密度的比拼，而是度复杂的物理学与热力学挑战。

台积电十余年千里淀的材料交互数据与热历史模子，组成了其坚实的护城河。追逐者不仅要攻克基板微裂纹、临时键残渣等单步工艺痛点，要在宽绰的堆叠结构中截止翘曲放大和应力积贮，避错误传递致的系统良率问题。

与此同期，这种技巧欢快在不同驾驭场景中展现出较着的分层。围绕大尺寸封装和面板加工的探索，险些由 AI 与能揣摸驱动；而在对恒久可靠要求的汽车电子等域，传统的老到案依然占据主。这意味着国内封测企业在旅途遴荐上需要缜密的交易判断，在有限资源下，针对不同卑劣商场采纳各异化战术，而非盲目追逐整个前沿主见。

论是站在前沿的开垦者，如故戮力追击的原土企业，终的考试齐在于谁能当先在材料、结构与热历史的复杂博弈中，将良率自若在具备交易竞争力的水平上。这是谈其冗忙的系统集成答题，而留给追逐者摸索工艺窗口的时分，正在连忙荏苒。

1. https://semiengineering.com/advanced-packaging-limits-come-into-focus/

2.https://www.mckinsey.com/industries/semiconductors/our-insights/advanced-chip-packaging-how-manufacturers-can-play-to-win

运营/排版：何晨龙

注：封面/图由 AI 扶植生成

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